CAT93C86
SK
t DIS
t SKHI
t SKLOW
t DIH
t CSH
DI
CS
t CSS
VALID
VALID
SK
DO
t DIS
Figure 2. Synchronous Data Timing
t PD0 , t PD1
DATA VALID
t CSMIN
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
CS
A N
A N ? 1
A 0
Don’t Care
DI
DO
1
1
0
HIGH ? Z
Dummy 0
D 15 . . . D 0
or
D 7 . . . D 0
Address + 1
D 15 . . . D 0
or
D 7 . . . D 0
Address + 2
D 15 . . . D 0
or
D 7 . . . D 0
Address + n
D 15 . . .
or
D 7 . . .
Figure 3. Read Instruction Timing
SK
t CSMIN
CS
A N A N ? 1
A 0
D N
D 0
STATUS
VERIFY
STANDBY
DI
1
0
1
DO
HIGH ? Z
t SV
BUSY
READY
t HZ
HIGH ? Z
t EW
Figure 4. Write Instruction Timing
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5
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